Sobre el avance de la encriptación cuántica resistente, el fundador de Cardano, Charles Hoskinson, recientemente hizo un análisis interesante. El Instituto Nacional de Estándares y Tecnología de EE. UU. ha completado la estandarización de las soluciones de encriptación cuántica resistente en 2024, lo que suena como un buen progreso. Pero aquí hay un problema real: la falta de soporte de aceleración de hardware.



¿Qué significa la falta de aceleración de hardware? Los costos de cálculo se dispararán, la escala de datos también aumentará drásticamente, y el resultado final es que el rendimiento de la encriptación de bloques disminuirá notablemente. Hoskinson señala que la pérdida de rendimiento podría alcanzar un orden de magnitud, lo cual no es un asunto menor.

Sin embargo, él cree que la verdadera clave no está en "cómo hacerlo", sino en "cuándo hacerlo". Cuándo los riesgos de la encriptación cuántica realmente amenazarán los sistemas existentes, es la cuestión que necesita ser evaluada seriamente. El programa de pruebas de referencia cuántica de DARPA nos da un cronograma de referencia: se espera que antes de 2033 se evalúe la viabilidad de la encriptación cuántica práctica. Esto significa que aún tenemos tiempo para sopesar el equilibrio entre la madurez tecnológica y las necesidades reales.
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AllInAlicevip
· hace4h
Si no hay aceleración de hardware, tendremos que esperar a que los fabricantes de chips se pongan al día, de lo contrario, es realmente un problema buscar una implementación tan temprana.
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Anon4461vip
· hace4h
Voy a quejarme un poco, ¿qué están diciendo sobre la resistencia cuántica sin aceleración de hardware? ¿Quién puede soportar una caída de rendimiento de un orden de magnitud...
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